AI代码解释 xpm_cdc_single #(.DEST_SYNC_FF(2),// DECIMAL; range: 2-10.INIT_SYNC_FF(0),// DECIMAL; 0=disable simulation init values, 1=enable simulation init values.SIM_ASSERT_CHK(0),// DECIMAL; 0=disable simulation messages, 1=enable simulation messages.SRC_INPUT_REG(1)// DECIMAL;...
AMD LogiCORE™ IP XPM CDC 核是一个构造函数,可生成各种 CDC(时钟域交叉)块 (Single-bit Array Synchronizer、Asynchronous Reset Synchronizer、Synchronizer via Gray Encoding, Bus Synchronizer with Full Handshake、Pulse Transfer、Single bit Synchronizer、Synchronous Reset Synchronizer)。
.src_in(reg_1) // 1-bit input: Input signal to be synchronized to dest_clk domain. xpm_cdc_single的原语,会自动插入ASYNC_REG属性,保证放到同一个Slice中。 审核编辑:刘清
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Clash.Cores.Xilinx.Xpm.Cdc.Single Expand Down 4 changes: 3 additions & 1 deletion4src/Clash/Cores/Xilinx/Xpm/Cdc.hs Original file line numberDiff line numberDiff line change Expand Up@@ -16,9 +16,11 @@ -} moduleClash.Cores.Xilinx.Xpm.Cdc ...
如果"CLOCKING_MODE" 设置为 "independent_clock" ,Vivado 可能会触发误报 CDC-1 警告,可以忽略。 UltraRAM 的专用输入和输出寄存器的使用由基于 READ_LATENCY_B 值的综合控制。例如,如果 4 个 UltraRAM 级联并且 READ_LATENCY_B ≥ 4,则综合将尽可能多地吸收 UltraRAM 原语中的寄存器。
133 135 Clash.Cores.Xilinx.Xpm.Cdc.Single.Internal 134 136 Clash.Cores.SPI src/Clash/Cores/Xilinx/Xpm/Cdc.hs +2 Original file line numberDiff line numberDiff line change @@ -18,9 +18,11 @@ 18 18 module Clash.Cores.Xilinx.Xpm.Cdc 19 19 ( xpmCdcArraySingle 20 20 , xpmCdc...
.CDC_SYNC_STAGES(2), // DECIMAL .DOUT_RESET_VALUE("0"), // String .ECC_MODE("no_ecc"), // String .FIFO_MEMORY_TYPE("auto"), // String .FIFO_READ_LATENCY(1), // DECIMAL .FIFO_WRITE_DEPTH(2048), // DECIMAL .FULL_RESET_VALUE(0), // DECIMAL ...
Affected XPM_CDC modules: xpm_cdc_single xpm_cdc_handshake xpm_cdc_pulse xpm_cdc_array_singl xpm_cdc_sync_rst This issue was resolved in Vivado 2016.4. Vivado2016.2Vivado Design SuiteTiming And ConstraintsKnowledge Base Files(0)