上图为普通源随,其DC输出阻抗为1/gm1,通常是是一个相对的低阻点。 在诸如部分LDO应用中(见下图),我们需要一个理想Buffer来隔离输出传输管Gate端的大寄生电容,我们期望Buffer输出阻抗足够低,从而使得N2处的极点处于高频处(带宽之外),以改善系统稳定性。 普通源随的输出阻抗1/gm1的值与偏置电流相关,为了得到比较低...
RC串联支路补偿方案有效 R的取值和闭环带宽成正比,带宽越高,LDO 传输门Gate端极点频率越高 C的取值和闭环带宽无关,仅仅需要满足一定的约束条件,取值范围非常大
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LDO 1/4 创建者:好大条龙 收藏 FVF和SSF的输出阻抗 4014播放 微电子学第11话 Diff. Pairs Freq. Response (I) 3113播放 LDO Design - Analog Circuit Design Class Sample 模拟电路设计 2671播放 IDEC PMIC 第十讲 LDO Example of JSSC 2853播放...
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