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# Pull the latest RISC-V Docs container image: docker pull riscvintl/riscv-docs-base-container-image:latest git clone https://github.com/riscv/riscv-debug-spec.git cd riscv-debug-spec # Optionally, check out a specific revision: # git checkout <rev> git submodule update --init --rec...
香山是在中科院计算所、鹏城实验室的支持下，通过中国开放指令生态（RISC-V）联盟联合业界企业一起开发一款开源高性能 RISC-V 处理器核，首个量产版本“雁栖湖”计划于今年 7 月流片，采用台积电 28nm 工艺。包云岗称，该项目经过了一年多的准备工作，建立团队并申请经费。2020 年 6 月 11 日，香山在 GitHub 上...
中国科学院计算技术研究所副所长、RISC-V国际基金会理事、中国开放指令生态（RISC-V）联盟秘书长包云岗昨日也在微博上表示：“RISC-V本身是一种标准，一种开放共享的标准，说的再直接一些——就是一本电子手册，谁也阻止不了下载和使用，包括美国政府。”至于可能存在的开源托管平台GitHub会受美国限制影响的问题，包云...
开源的E203在github上其实是一个SoC平台。E203使用自定义的类AXI接口，支持debug spec 0.11。唯一的缺憾是没有官方的verilator环境，如果使用verilator的话得自己搭个环境了。像我这种在家用不了商业仿真软件（也不愿意装D版）的硅农，只能用意念仿真了，目前还是看看代码，等有时间的话Port一个verilator仿真环境过去...
❝https://github.com/darklife/darkriscv 2、picoRiscV 这个其实不需要过多介绍了,小巧且完善的RISC-V。 PicoRV32 是实现RISC-V RV32IMC 指令集的 CPU 内核。它可以配置为 RV32E、RV32I、RV32IC、RV32IM 或 RV32IMC 内核,并可选择包含内置中断控制器。
https://github.com/isrc-cas/PLCT-Weekly RISC-V V Spec LLVM 实现进展 https://github.com/isrc-cas/rvv-llvm 上周忙论文,暂停更新一周。 永恒天平项目更新 简介:Eternal Balance(永恒天平)是PLCT内部测评体系,测评编译系统的性能速度、代码体积和安全性等方面。我们会及时公开测评结果。目前仍处在起步阶段,...
HEX-FIVE 公司在RV32 Core 做了IoT 分区保护的应用案例 10，见下图4，软件可参考开源代码https://github.com/hex-five/multizone-secure-iot-stack 。从图中我们可以看到，SOC 芯片是X300 Bitstream ，采用是开源Rocket RV32IMAC 内核。Digilent ARTY A7 FPAG开发板 ，配有以太网。软件上 MultiZone 安全可信...
1. SPEC跑分验证:在硬件设计中，一旦有了原型或早期版本的设计，就可以使用SPEC基准测试进行跑分，从而验证预期的性能是否得到实现。基于思尔芯的芯神瞳，“香山”团队运行了SPEC基准测试，通过结合显卡运行Linux和图形界面，以直观地评估其性能。这为团队提供了宝贵的反馈，可以据此进行优化以达到或超过预期的性能标准。
“香山”作为国际上最受关注的开源硬件项目之一,已在全球最大的开源项目托管平台GitHub上获得超过3580个星标,形成超过449个分支(Fork)。中科院软件所副所长武延军介绍“傲来”操作系统 随后,软件研究所副所长、总工程师武延军介绍了“傲来”RISC-V原生操作系统。作为“先导”专项亮点成果之一,“傲来”集成软件所的最新...