首先激活modelsim然后打开modelsim 新建project 选择要使用的语言,这里使用systemverilog 对于初学者,可以只使用一个文件编写主要模块和testbench(tb文件),所以这里直接关闭窗口 双击打开 填入测试代码 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 25 26 27 28 29 30 31 32 ...
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