ESD保护Layout指南 摘要 能否成功地保护系统免受静电放电(ESD) 的影响,很大程度上取决于印刷电路板(PCB) 设计。尽管选择合适的瞬态电压抑制器(TVS) 是 ESD 保护策略的基本之道,但不在本文讨论范围内。http://www.ti.com/esd上的技术文档提供了许多 ESD 选择指南,可指导如何为特定系统选择适当的 TVS 二极管类型。
器件布局：战略部署，步步为营 器件的布局位置，直接影响着 ESD 电流的流向。最佳策略是，将 TVS 器件尽可能靠近接口，就像在城门口布置精锐部队一样，第一时间拦截入侵者。同时，要将敏感器件远离 ESD 电流的路径，避免它们受到直接冲击。走线设计：高速公路还是羊肠小道？走线就像 ESD 电流的通道，好的走线设计，...
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ESD保护Layout 通常有避免ESD脉冲产生的传导干扰和电磁辐射干扰进入敏感的电子产品内部 PCB线,以及ESD 传导电流走最小阻抗路径这两种方式解决。 在ESD和TVS器件的应用中,其放置位置和PCB的走线设计对于静电保护至关重要。ESD/TVS器件的引脚PCB走线所产生的寄生电感能够显著增加整体的钳制电压。如图5所示,当ESD/EOS瞬态...
ESD保护Layout指南 写完上篇文章“为何Layout时信号走线要先过ESD/TVS管”,我又网上查了查资料,发现TI有一篇文档《ESD保护布局指南》,其对于为什么这样Layout也有一番详细的解释,跟我之前理解的原理差不多,相对来说,TI这个文档就全面多了,因此我就直接分享给兄弟们(文末也会给出官网下载链接)。
写完上篇文章“为何Layout时信号走线要先过ESD/TVS管”,我又网上查了查资料,发现TI有一篇文档《ESD保护布局指南》,其对于为什么这样Layout也有一番详细的解释,跟我之前理解的原理差不多,相对来说,TI这个文档就全面多了,因此我就直接分享给兄弟们(文末也会给出官网下载链接)。
如果Layout引入寄生电感,ESD泄放的时候电流也会在电感上面形成压降,导致芯片端残压升高,如果电压高于了芯片的耐受电压,那么就会击穿芯片,导致防护失败。上面说法还是笼统,下面我们拿数据说话。走线电感的阻抗很多人可能会认为走线电感,那不就是寄生电感吗,听起来就很小,不能直接忽略吗?能不能忽略自然就是看影响,只有...
ESD静电保护Layout指南(静电保护二极管) 能否成功地保护系统免受静电放电 (ESD) 的影响,很大程度上取决于印刷电路板 (PCB) 设计。尽管选择合适的瞬态电压抑制器 (TVS) 是 ESD 保护策略的基本之道,但不在本文讨论范围内。ti.com/esd 上的技术文档提供了许多 ESD 选择指南,可指导如何为特定系统选择适当的 TVS ...
本文主要说下自己对于ESD管的Layout要求的理解,主要从寄生电感的角度来说的,虽说文章有一些数据,但是整体还算是定性分析。实际情况是更为复杂的,比如说ESD管到MCU也有走线,也有寄生电感,这对ESD更为友好一点。还有就是如果寄生电感大了,ESD的泄放电流应该也会小一些,而我上面的数据都是假设Ipp是1A时的。