一堆CSR[2]寄存器用来提供运行参数,PMU可以通过APB总线访问到。 ACSM (Address-Command State Machine): 每个PHY有一个,操控命令线生成测试指令。 DTSM (Data-Training State Machine): 可以每个DBYTE有9个,或者每个DQ一个。用来比较实际接收值与期望值,记录失败次数,达到阈值后设置标记。 PPGC (PRBS Pattern Gene...
制定DDR协议的固态技术协会(JEDEC)标准组织并没有在规范中要求动态随机存取存储器(DRAM)需要具备调整输入输出信号延时的能力,于是通常DDR PHY就承担起了输入和输出两个方向的延时调整工作,这个调整的过程称为训练(training)。训练是为了使DDR PHY输出信号能符合固态技术协会标准的要求,DDR PHY通过调节发送端的延迟线(del...
制定DDR协议的固态技术协会(JEDEC)标准组织并没有在规范中要求动态随机存取存储器(DRAM)需要具备调整输入输出信号延时的能力,于是通常DDR PHY就承担起了输入和输出两个方向的延时调整工作,这个调整的过程称为训练(training)。训练是为了使DDR PHY输出信号能符合固态技术协会标准的要求,DDR PHY通过调节发送端的延迟线(del...
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DDR PHY Training工作流程介绍 DDR作为高速传输总线，对时序的要求非常严格。为补偿外界因素引起的时序误差，使用前需进行training以找到良好状态的偏移值。DesignWare DDR PHY IP提供training firmware执行流程，运行于内部PMU中，通过message block接收参数，查询training结果。流程包含1D training和2D training两...
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支持DRAM 的Training 支持BIST 支持待机唤醒 支持低功耗、展频 对吧,后面发现有遗漏咱们再补充。继续继续往下聊! 首先迎来的就是入口DFI。 DFI 内存控制器逻辑和PHY接口是DDR内存系统中的两个主要设计元素,这些系统几乎应用于所有电子系统设计中,从手机、机顶盒到计算机和网络路由器。内存系统的这两个组件需要一套独特...