需要提醒用户的是:实际上我们根据AD7606C-18芯片的时序,利用Verilog编写了驱动IP,生成网表再利用LabVIEW FPGA的IP Block节点进行调用,如图13所示,这种方式不直观;应广大企业客户需求,我们直接在LabVIEW FPGA框图里面利用状态机编程,直接将AD7606C芯片的整个操作和读取用LabVIEW FPGA编写出来了,每一步都能看到,如图14所...
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