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金融界2024年11月30日消息，国家知识产权局信息显示，西安智多晶微电子有限公司取得一项名为“用于FPGA芯片的高速串并转换接口字同步方法和电路”的专利，授权公告号 CN 111130560 B，申请日期为 2019年12月。本文源自：金融界 作者：情报员
西安智多晶微电子取得用于FPGA芯片的高速串并转换接口字同步方法和电路专利 |快报 返回搜狐,查看更多 平台声明:该文观点仅代表作者本人,搜狐号系信息发布平台,搜狐仅提供信息存储空间服务。
传统的LVDS采用同步时钟的方式,使用一对差分时钟,为最多三对数据信号提供时钟参考。每个时钟周期内,每对数据传输7 bits信息。需要用到SerDes芯片,在发送时,将并行信号通过并/串转换,变成高速串行信号;在接收到高速串行信号时,使用串/并转换,还原并行信号。
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本发明公开了一种用于FPGA芯片的高 速串并转换接口字同步方法和电路,所述方法包 括:利用串并转换模块将接收的串行数据信号转 换为并行数据信号;比较所述并行数据信号与预 先设置的字同步字符,获得字同步控制信号;根 据所述字同步控制信号在串并转换过程中重复进 ...
CPLD可编程技术具有功能集成度高、设计灵活、开发周期短、成本低等特点。介绍基于ATMEL公司的CPLD芯片ATF1508AS设计的串并转换和高速USB及其在高速高精度数据采集系统中的应用。。
本发明公开了一种用于FPGA芯片的高速串并转换接口字同步方法和电路,所述方法包括:利用串并转换模块将接收的串行数据信号转换为并行数据信号;比较所述并行数据信号与预先设置的字同步字符,获得字同步控制信号;根据所述字同步控制信号在串并转换过程中重复进行字同步操作,直到所述并行数据信号与预先设置的字同步字符一致;...